include/asm-i386/processor.h

   1 /*
   2  * include/asm-i386/processor.h
   3  *
   4  * Copyright (C) 1994 Linus Torvalds
   5  */
   6
   7 #ifndef __ASM_I386_PROCESSOR_H
   8 #define __ASM_I386_PROCESSOR_H
   9
  10 #include <asm/vm86.h>
  11 #include <asm/math_emu.h>
  12 #include <asm/segment.h>
  13 #include <asm/page.h>
  14 #include <asm/types.h>
  15 #include <asm/sigcontext.h>
  16 #include <asm/cpufeature.h>
  17 #include <asm/msr.h>
  18 #include <asm/system.h>
  19 #include <linux/cache.h>
  20 #include <linux/threads.h>
  21 #include <asm/percpu.h>
  22 #include <linux/cpumask.h>
  23 #include <linux/init.h>
  24
  25 /* flag for disabling the tsc */
  26 extern int tsc_disable;
  27
  28 struct desc_struct {
  29         unsigned long a,b;
  30 };
  31
  32 #define desc_empty(desc) \
  33                 (!((desc)->a | (desc)->b))
  34
  35 #define desc_equal(desc1, desc2) \
  36                 (((desc1)->a == (desc2)->a) && ((desc1)->b == (desc2)->b))
  37 /*
  38  * Default implementation of macro that returns current
  39  * instruction pointer ("program counter").
  40  */
  41 #define current_text_addr() ({ void *pc; __asm__("movl $1f,%0\n1:":"=g" (pc)); pc; })
  42
  43 /*
  44  *  CPU type and hardware bug flags. Kept separately for each CPU.
  45  *  Members of this structure are referenced in head.S, so think twice
  46  *  before touching them. [mj]
  47  */
  48
  49 struct cpuinfo_x86 {
  50         __u8    x86;            /* CPU family */
  51         __u8    x86_vendor;     /* CPU vendor */
  52         __u8    x86_model;
  53         __u8    x86_mask;
  54         char    wp_works_ok;    /* It doesn't on 386's */
  55         char    hlt_works_ok;   /* Problems on some 486Dx4's and old 386's */
  56         char    hard_math;
  57         char    rfu;
  58         int     cpuid_level;    /* Maximum supported CPUID level, -1=no CPUID */
  59         unsigned long   x86_capability[NCAPINTS];
  60         char    x86_vendor_id[16];
  61         char    x86_model_id[64];
  62         int     x86_cache_size;  /* in KB - valid for CPUS which support this
  63                                     call  */
  64         int     x86_cache_alignment;    /* In bytes */
  65         char    fdiv_bug;
  66         char    f00f_bug;
  67         char    coma_bug;
  68         char    pad0;
  69         int     x86_power;
  70         unsigned long loops_per_jiffy;
  71 #ifdef CONFIG_SMP
  72         cpumask_t llc_shared_map;       /* cpus sharing the last level cache */
  73 #endif
  74         unsigned char x86_max_cores;    /* cpuid returned max cores value */
  75         unsigned char apicid;
  76         unsigned short x86_clflush_size;
  77 #ifdef CONFIG_SMP
  78         unsigned char booted_cores;     /* number of cores as seen by OS */
  79         __u8 phys_proc_id;              /* Physical processor id. */
  80         __u8 cpu_core_id;               /* Core id */
  81 #endif
  82 } __attribute__((__aligned__(SMP_CACHE_BYTES)));
  83
  84 #define X86_VENDOR_INTEL 0
  85 #define X86_VENDOR_CYRIX 1
  86 #define X86_VENDOR_AMD 2
  87 #define X86_VENDOR_UMC 3
  88 #define X86_VENDOR_NEXGEN 4
  89 #define X86_VENDOR_CENTAUR 5
  90 #define X86_VENDOR_RISE 6
  91 #define X86_VENDOR_TRANSMETA 7
  92 #define X86_VENDOR_NSC 8
  93 #define X86_VENDOR_NUM 9
  94 #define X86_VENDOR_UNKNOWN 0xff
  95
  96 /*
  97  * capabilities of CPUs
  98  */
  99
 100 extern struct cpuinfo_x86 boot_cpu_data;
 101 extern struct cpuinfo_x86 new_cpu_data;
 102 extern struct tss_struct doublefault_tss;
 103 DECLARE_PER_CPU(struct tss_struct, init_tss);
 104
 105 #ifdef CONFIG_SMP
 106 extern struct cpuinfo_x86 cpu_data[];
 107 #define current_cpu_data cpu_data[smp_processor_id()]
 108 #else
 109 #define cpu_data (&boot_cpu_data)
 110 #define current_cpu_data boot_cpu_data
 111 #endif
 112
 113 extern  int cpu_llc_id[NR_CPUS];
 114 extern char ignore_fpu_irq;
 115
 116 void __init cpu_detect(struct cpuinfo_x86 *c);
 117
 118 extern void identify_cpu(struct cpuinfo_x86 *);
 119 extern void print_cpu_info(struct cpuinfo_x86 *);
 120 extern unsigned int init_intel_cacheinfo(struct cpuinfo_x86 *c);
 121 extern unsigned short num_cache_leaves;
 122
 123 #ifdef CONFIG_X86_HT
 124 extern void detect_ht(struct cpuinfo_x86 *c);
 125 #else
 126 static inline void detect_ht(struct cpuinfo_x86 *c) {}
 127 #endif
 128
 129 /*
 130  * EFLAGS bits
 131  */
 132 #define X86_EFLAGS_CF   0x00000001 /* Carry Flag */
 133 #define X86_EFLAGS_PF   0x00000004 /* Parity Flag */
 134 #define X86_EFLAGS_AF   0x00000010 /* Auxillary carry Flag */
 135 #define X86_EFLAGS_ZF   0x00000040 /* Zero Flag */
 136 #define X86_EFLAGS_SF   0x00000080 /* Sign Flag */
 137 #define X86_EFLAGS_TF   0x00000100 /* Trap Flag */
 138 #define X86_EFLAGS_IF   0x00000200 /* Interrupt Flag */
 139 #define X86_EFLAGS_DF   0x00000400 /* Direction Flag */
 140 #define X86_EFLAGS_OF   0x00000800 /* Overflow Flag */
 141 #define X86_EFLAGS_IOPL 0x00003000 /* IOPL mask */
 142 #define X86_EFLAGS_NT   0x00004000 /* Nested Task */
 143 #define X86_EFLAGS_RF   0x00010000 /* Resume Flag */
 144 #define X86_EFLAGS_VM   0x00020000 /* Virtual Mode */
 145 #define X86_EFLAGS_AC   0x00040000 /* Alignment Check */
 146 #define X86_EFLAGS_VIF  0x00080000 /* Virtual Interrupt Flag */
 147 #define X86_EFLAGS_VIP  0x00100000 /* Virtual Interrupt Pending */
 148 #define X86_EFLAGS_ID   0x00200000 /* CPUID detection flag */
 149
 150 static inline fastcall void native_cpuid(unsigned int *eax, unsigned int *ebx,
 151                                          unsigned int *ecx, unsigned int *edx)
 152 {
 153         /* ecx is often an input as well as an output. */
 154         __asm__("cpuid"
 155                 : "=a" (*eax),
 156                   "=b" (*ebx),
 157                   "=c" (*ecx),
 158                   "=d" (*edx)
 159                 : "0" (*eax), "2" (*ecx));
 160 }
 161
 162 #define load_cr3(pgdir) write_cr3(__pa(pgdir))
 163
 164 /*
 165  * Intel CPU features in CR4
 166  */
 167 #define X86_CR4_VME             0x0001  /* enable vm86 extensions */
 168 #define X86_CR4_PVI             0x0002  /* virtual interrupts flag enable */
 169 #define X86_CR4_TSD             0x0004  /* disable time stamp at ipl 3 */
 170 #define X86_CR4_DE              0x0008  /* enable debugging extensions */
 171 #define X86_CR4_PSE             0x0010  /* enable page size extensions */
 172 #define X86_CR4_PAE             0x0020  /* enable physical address extensions */
 173 #define X86_CR4_MCE             0x0040  /* Machine check enable */
 174 #define X86_CR4_PGE             0x0080  /* enable global pages */
 175 #define X86_CR4_PCE             0x0100  /* enable performance counters at ipl 3 */
 176 #define X86_CR4_OSFXSR          0x0200  /* enable fast FPU save and restore */
 177 #define X86_CR4_OSXMMEXCPT      0x0400  /* enable unmasked SSE exceptions */
 178
 179 /*
 180  * Save the cr4 feature set we're using (ie
 181  * Pentium 4MB enable and PPro Global page
 182  * enable), so that any CPU's that boot up
 183  * after us can get the correct flags.
 184  */
 185 extern unsigned long mmu_cr4_features;
 186
 187 static inline void set_in_cr4 (unsigned long mask)
 188 {
 189         unsigned cr4;
 190         mmu_cr4_features |= mask;
 191         cr4 = read_cr4();
 192         cr4 |= mask;
 193         write_cr4(cr4);
 194 }
 195
 196 static inline void clear_in_cr4 (unsigned long mask)
 197 {
 198         unsigned cr4;
 199         mmu_cr4_features &= ~mask;
 200         cr4 = read_cr4();
 201         cr4 &= ~mask;
 202         write_cr4(cr4);
 203 }
 204
 205 /*
 206  *      NSC/Cyrix CPU configuration register indexes
 207  */
 208
 209 #define CX86_PCR0 0x20
 210 #define CX86_GCR  0xb8
 211 #define CX86_CCR0 0xc0
 212 #define CX86_CCR1 0xc1
 213 #define CX86_CCR2 0xc2
 214 #define CX86_CCR3 0xc3
 215 #define CX86_CCR4 0xe8
 216 #define CX86_CCR5 0xe9
 217 #define CX86_CCR6 0xea
 218 #define CX86_CCR7 0xeb
 219 #define CX86_PCR1 0xf0
 220 #define CX86_DIR0 0xfe
 221 #define CX86_DIR1 0xff
 222 #define CX86_ARR_BASE 0xc4
 223 #define CX86_RCR_BASE 0xdc
 224
 225 /*
 226  *      NSC/Cyrix CPU indexed register access macros
 227  */
 228
 229 #define getCx86(reg) ({ outb((reg), 0x22); inb(0x23); })
 230
 231 #define setCx86(reg, data) do { \
 232         outb((reg), 0x22); \
 233         outb((data), 0x23); \
 234 } while (0)
 235
 236 /* Stop speculative execution */
 237 static inline void sync_core(void)
 238 {
 239         int tmp;
 240         asm volatile("cpuid" : "=a" (tmp) : "0" (1) : "ebx","ecx","edx","memory");
 241 }
 242
 243 static inline void __monitor(const void *eax, unsigned long ecx,
 244                 unsigned long edx)
 245 {
 246         /* "monitor %eax,%ecx,%edx;" */
 247         asm volatile(
 248                 ".byte 0x0f,0x01,0xc8;"
 249                 : :"a" (eax), "c" (ecx), "d"(edx));
 250 }
 251
 252 static inline void __mwait(unsigned long eax, unsigned long ecx)
 253 {
 254         /* "mwait %eax,%ecx;" */
 255         asm volatile(
 256                 ".byte 0x0f,0x01,0xc9;"
 257                 : :"a" (eax), "c" (ecx));
 258 }
 259
 260 extern void mwait_idle_with_hints(unsigned long eax, unsigned long ecx);
 261
 262 /* from system description table in BIOS.  Mostly for MCA use, but
 263 others may find it useful. */
 264 extern unsigned int machine_id;
 265 extern unsigned int machine_submodel_id;
 266 extern unsigned int BIOS_revision;
 267 extern unsigned int mca_pentium_flag;
 268
 269 /* Boot loader type from the setup header */
 270 extern int bootloader_type;
 271
 272 /*
 273  * User space process size: 3GB (default).
 274  */
 275 #define TASK_SIZE       (PAGE_OFFSET)
 276
 277 /* This decides where the kernel will search for a free chunk of vm
 278  * space during mmap's.
 279  */
 280 #define TASK_UNMAPPED_BASE      PAGE_ALIGN(TASK_SIZE/3)
 281
 282 #define __HAVE_ARCH_ALIGN_STACK
 283 extern unsigned long arch_align_stack(unsigned long sp);
 284
 285 #define HAVE_ARCH_PICK_MMAP_LAYOUT
 286
 287 /*
 288  * Size of io_bitmap.
 289  */
 290 #define IO_BITMAP_BITS  65536
 291 #define IO_BITMAP_BYTES (IO_BITMAP_BITS/8)
 292 #define IO_BITMAP_LONGS (IO_BITMAP_BYTES/sizeof(long))
 293 #define IO_BITMAP_OFFSET offsetof(struct tss_struct,io_bitmap)
 294 #define INVALID_IO_BITMAP_OFFSET 0x8000
 295 #define INVALID_IO_BITMAP_OFFSET_LAZY 0x9000
 296
 297 struct i387_fsave_struct {
 298         long    cwd;
 299         long    swd;
 300         long    twd;
 301         long    fip;
 302         long    fcs;
 303         long    foo;
 304         long    fos;
 305         long    st_space[20];   /* 8*10 bytes for each FP-reg = 80 bytes */
 306         long    status;         /* software status information */
 307 };
 308
 309 struct i387_fxsave_struct {
 310         unsigned short  cwd;
 311         unsigned short  swd;
 312         unsigned short  twd;
 313         unsigned short  fop;
 314         long    fip;
 315         long    fcs;
 316         long    foo;
 317         long    fos;
 318         long    mxcsr;
 319         long    mxcsr_mask;
 320         long    st_space[32];   /* 8*16 bytes for each FP-reg = 128 bytes */
 321         long    xmm_space[32];  /* 8*16 bytes for each XMM-reg = 128 bytes */
 322         long    padding[56];
 323 } __attribute__ ((aligned (16)));
 324
 325 struct i387_soft_struct {
 326         long    cwd;
 327         long    swd;
 328         long    twd;
 329         long    fip;
 330         long    fcs;
 331         long    foo;
 332         long    fos;
 333         long    st_space[20];   /* 8*10 bytes for each FP-reg = 80 bytes */
 334         unsigned char   ftop, changed, lookahead, no_update, rm, alimit;
 335         struct info     *info;
 336         unsigned long   entry_eip;
 337 };
 338
 339 union i387_union {
 340         struct i387_fsave_struct        fsave;
 341         struct i387_fxsave_struct       fxsave;
 342         struct i387_soft_struct soft;
 343 };
 344
 345 typedef struct {
 346         unsigned long seg;
 347 } mm_segment_t;
 348
 349 struct thread_struct;
 350
 351 struct tss_struct {
 352         unsigned short  back_link,__blh;
 353         unsigned long   esp0;
 354         unsigned short  ss0,__ss0h;
 355         unsigned long   esp1;
 356         unsigned short  ss1,__ss1h;     /* ss1 is used to cache MSR_IA32_SYSENTER_CS */
 357         unsigned long   esp2;
 358         unsigned short  ss2,__ss2h;
 359         unsigned long   __cr3;
 360         unsigned long   eip;
 361         unsigned long   eflags;
 362         unsigned long   eax,ecx,edx,ebx;
 363         unsigned long   esp;
 364         unsigned long   ebp;
 365         unsigned long   esi;
 366         unsigned long   edi;
 367         unsigned short  es, __esh;
 368         unsigned short  cs, __csh;
 369         unsigned short  ss, __ssh;
 370         unsigned short  ds, __dsh;
 371         unsigned short  fs, __fsh;
 372         unsigned short  gs, __gsh;
 373         unsigned short  ldt, __ldth;
 374         unsigned short  trace, io_bitmap_base;
 375         /*
 376          * The extra 1 is there because the CPU will access an
 377          * additional byte beyond the end of the IO permission
 378          * bitmap. The extra byte must be all 1 bits, and must
 379          * be within the limit.
 380          */
 381         unsigned long   io_bitmap[IO_BITMAP_LONGS + 1];
 382         /*
 383          * Cache the current maximum and the last task that used the bitmap:
 384          */
 385         unsigned long io_bitmap_max;
 386         struct thread_struct *io_bitmap_owner;
 387         /*
 388          * pads the TSS to be cacheline-aligned (size is 0x100)
 389          */
 390         unsigned long __cacheline_filler[35];
 391         /*
 392          * .. and then another 0x100 bytes for emergency kernel stack
 393          */
 394         unsigned long stack[64];
 395 } __attribute__((packed));
 396
 397 #define ARCH_MIN_TASKALIGN      16
 398
 399 struct thread_struct {
 400 /* cached TLS descriptors. */
 401         struct desc_struct tls_array[GDT_ENTRY_TLS_ENTRIES];
 402         unsigned long   esp0;
 403         unsigned long   sysenter_cs;
 404         unsigned long   eip;
 405         unsigned long   esp;
 406         unsigned long   fs;
 407         unsigned long   gs;
 408 /* Hardware debugging registers */
 409         unsigned long   debugreg[8];  /* %%db0-7 debug registers */
 410 /* fault info */
 411         unsigned long   cr2, trap_no, error_code;
 412 /* floating point info */
 413         union i387_union        i387;
 414 /* virtual 86 mode info */
 415         struct vm86_struct __user * vm86_info;
 416         unsigned long           screen_bitmap;
 417         unsigned long           v86flags, v86mask, saved_esp0;
 418         unsigned int            saved_fs, saved_gs;
 419 /* IO permissions */
 420         unsigned long   *io_bitmap_ptr;
 421         unsigned long   iopl;
 422 /* max allowed port in the bitmap, in bytes: */
 423         unsigned long   io_bitmap_max;
 424 };
 425
 426 #define INIT_THREAD  {                                                  \
 427         .vm86_info = NULL,                                              \
 428         .sysenter_cs = __KERNEL_CS,                                     \
 429         .io_bitmap_ptr = NULL,                                          \
 430         .gs = __KERNEL_PDA,                                             \
 431 }
 432
 433 /*
 434  * Note that the .io_bitmap member must be extra-big. This is because
 435  * the CPU will access an additional byte beyond the end of the IO
 436  * permission bitmap. The extra byte must be all 1 bits, and must
 437  * be within the limit.
 438  */
 439 #define INIT_TSS  {                                                     \
 440         .esp0           = sizeof(init_stack) + (long)&init_stack,       \
 441         .ss0            = __KERNEL_DS,                                  \
 442         .ss1            = __KERNEL_CS,                                  \
 443         .io_bitmap_base = INVALID_IO_BITMAP_OFFSET,                     \
 444         .io_bitmap      = { [ 0 ... IO_BITMAP_LONGS] = ~0 },            \
 445 }
 446
 447 #define start_thread(regs, new_eip, new_esp) do {               \
 448         __asm__("movl %0,%%fs": :"r" (0));                      \
 449         regs->xgs = 0;                                          \
 450         set_fs(USER_DS);                                        \
 451         regs->xds = __USER_DS;                                  \
 452         regs->xes = __USER_DS;                                  \
 453         regs->xss = __USER_DS;                                  \
 454         regs->xcs = __USER_CS;                                  \
 455         regs->eip = new_eip;                                    \
 456         regs->esp = new_esp;                                    \
 457         preempt_disable();                                      \
 458         load_user_cs_desc(smp_processor_id(), current->mm);     \
 459         preempt_enable();                                       \
 460 } while (0)
 461
 462 /* Forward declaration, a strange C thing */
 463 struct task_struct;
 464 struct mm_struct;
 465
 466 /* Free all resources held by a thread. */
 467 extern void release_thread(struct task_struct *);
 468
 469 /* Prepare to copy thread state - unlazy all lazy status */
 470 extern void prepare_to_copy(struct task_struct *tsk);
 471
 472 /*
 473  * create a kernel thread without removing it from tasklists
 474  */
 475 extern int kernel_thread(int (*fn)(void *), void * arg, unsigned long flags);
 476
 477 extern unsigned long thread_saved_pc(struct task_struct *tsk);
 478 void show_trace(struct task_struct *task, struct pt_regs *regs, unsigned long *stack);
 479
 480 unsigned long get_wchan(struct task_struct *p);
 481
 482 #define THREAD_SIZE_LONGS      (THREAD_SIZE/sizeof(unsigned long))
 483 #define KSTK_TOP(info)                                                 \
 484 ({                                                                     \
 485        unsigned long *__ptr = (unsigned long *)(info);                 \
 486        (unsigned long)(&__ptr[THREAD_SIZE_LONGS]);                     \
 487 })
 488
 489 /*
 490  * The below -8 is to reserve 8 bytes on top of the ring0 stack.
 491  * This is necessary to guarantee that the entire "struct pt_regs"
 492  * is accessable even if the CPU haven't stored the SS/ESP registers
 493  * on the stack (interrupt gate does not save these registers
 494  * when switching to the same priv ring).
 495  * Therefore beware: accessing the xss/esp fields of the
 496  * "struct pt_regs" is possible, but they may contain the
 497  * completely wrong values.
 498  */
 499 #define task_pt_regs(task)                                             \
 500 ({                                                                     \
 501        struct pt_regs *__regs__;                                       \
 502        __regs__ = (struct pt_regs *)(KSTK_TOP(task_stack_page(task))-8); \
 503        __regs__ - 1;                                                   \
 504 })
 505
 506 #define KSTK_EIP(task) (task_pt_regs(task)->eip)
 507 #define KSTK_ESP(task) (task_pt_regs(task)->esp)
 508
 509
 510 struct microcode_header {
 511         unsigned int hdrver;
 512         unsigned int rev;
 513         unsigned int date;
 514         unsigned int sig;
 515         unsigned int cksum;
 516         unsigned int ldrver;
 517         unsigned int pf;
 518         unsigned int datasize;
 519         unsigned int totalsize;
 520         unsigned int reserved[3];
 521 };
 522
 523 struct microcode {
 524         struct microcode_header hdr;
 525         unsigned int bits[0];
 526 };
 527
 528 typedef struct microcode microcode_t;
 529 typedef struct microcode_header microcode_header_t;
 530
 531 /* microcode format is extended from prescott processors */
 532 struct extended_signature {
 533         unsigned int sig;
 534         unsigned int pf;
 535         unsigned int cksum;
 536 };
 537
 538 struct extended_sigtable {
 539         unsigned int count;
 540         unsigned int cksum;
 541         unsigned int reserved[3];
 542         struct extended_signature sigs[0];
 543 };
 544
 545 /* REP NOP (PAUSE) is a good thing to insert into busy-wait loops. */
 546 static inline void rep_nop(void)
 547 {
 548         __asm__ __volatile__("rep;nop": : :"memory");
 549 }
 550
 551 #define cpu_relax()     rep_nop()
 552
 553 #ifdef CONFIG_PARAVIRT
 554 #include <asm/paravirt.h>
 555 #else
 556 #define paravirt_enabled() 0
 557 #define __cpuid native_cpuid
 558
 559 static inline void load_esp0(struct tss_struct *tss, struct thread_struct *thread)
 560 {
 561         tss->esp0 = thread->esp0;
 562         /* This can only happen when SEP is enabled, no need to test "SEP"arately */
 563         if (unlikely(tss->ss1 != thread->sysenter_cs)) {
 564                 tss->ss1 = thread->sysenter_cs;
 565                 wrmsr(MSR_IA32_SYSENTER_CS, thread->sysenter_cs, 0);
 566         }
 567 }
 568
 569 /*
 570  * These special macros can be used to get or set a debugging register
 571  */
 572 #define get_debugreg(var, register)                             \
 573                 __asm__("movl %%db" #register ", %0"            \
 574                         :"=r" (var))
 575 #define set_debugreg(value, register)                   \
 576                 __asm__("movl %0,%%db" #register                \
 577                         : /* no output */                       \
 578                         :"r" (value))
 579
 580 #define set_iopl_mask native_set_iopl_mask
 581 #endif /* CONFIG_PARAVIRT */
 582
 583 /*
 584  * Set IOPL bits in EFLAGS from given mask
 585  */
 586 static fastcall inline void native_set_iopl_mask(unsigned mask)
 587 {
 588         unsigned int reg;
 589         __asm__ __volatile__ ("pushfl;"
 590                               "popl %0;"
 591                               "andl %1, %0;"
 592                               "orl %2, %0;"
 593                               "pushl %0;"
 594                               "popfl"
 595                                 : "=&r" (reg)
 596                                 : "i" (~X86_EFLAGS_IOPL), "r" (mask));
 597 }
 598
 599 /*
 600  * Generic CPUID function
 601  * clear %ecx since some cpus (Cyrix MII) do not set or clear %ecx
 602  * resulting in stale register contents being returned.
 603  */
 604 static inline void cpuid(unsigned int op, unsigned int *eax, unsigned int *ebx, unsigned int *ecx, unsigned int *edx)
 605 {
 606         *eax = op;
 607         *ecx = 0;
 608         __cpuid(eax, ebx, ecx, edx);
 609 }
 610
 611 /* Some CPUID calls want 'count' to be placed in ecx */
 612 static inline void cpuid_count(int op, int count, int *eax, int *ebx, int *ecx,
 613                                int *edx)
 614 {
 615         *eax = op;
 616         *ecx = count;
 617         __cpuid(eax, ebx, ecx, edx);
 618 }
 619
 620 /*
 621  * CPUID functions returning a single datum
 622  */
 623 static inline unsigned int cpuid_eax(unsigned int op)
 624 {
 625         unsigned int eax, ebx, ecx, edx;
 626
 627         cpuid(op, &eax, &ebx, &ecx, &edx);
 628         return eax;
 629 }
 630 static inline unsigned int cpuid_ebx(unsigned int op)
 631 {
 632         unsigned int eax, ebx, ecx, edx;
 633
 634         cpuid(op, &eax, &ebx, &ecx, &edx);
 635         return ebx;
 636 }
 637 static inline unsigned int cpuid_ecx(unsigned int op)
 638 {
 639         unsigned int eax, ebx, ecx, edx;
 640
 641         cpuid(op, &eax, &ebx, &ecx, &edx);
 642         return ecx;
 643 }
 644 static inline unsigned int cpuid_edx(unsigned int op)
 645 {
 646         unsigned int eax, ebx, ecx, edx;
 647
 648         cpuid(op, &eax, &ebx, &ecx, &edx);
 649         return edx;
 650 }
 651
 652 /* generic versions from gas */
 653 #define GENERIC_NOP1    ".byte 0x90\n"
 654 #define GENERIC_NOP2            ".byte 0x89,0xf6\n"
 655 #define GENERIC_NOP3        ".byte 0x8d,0x76,0x00\n"
 656 #define GENERIC_NOP4        ".byte 0x8d,0x74,0x26,0x00\n"
 657 #define GENERIC_NOP5        GENERIC_NOP1 GENERIC_NOP4
 658 #define GENERIC_NOP6    ".byte 0x8d,0xb6,0x00,0x00,0x00,0x00\n"
 659 #define GENERIC_NOP7    ".byte 0x8d,0xb4,0x26,0x00,0x00,0x00,0x00\n"
 660 #define GENERIC_NOP8    GENERIC_NOP1 GENERIC_NOP7
 661
 662 /* Opteron nops */
 663 #define K8_NOP1 GENERIC_NOP1
 664 #define K8_NOP2 ".byte 0x66,0x90\n"
 665 #define K8_NOP3 ".byte 0x66,0x66,0x90\n"
 666 #define K8_NOP4 ".byte 0x66,0x66,0x66,0x90\n"
 667 #define K8_NOP5 K8_NOP3 K8_NOP2
 668 #define K8_NOP6 K8_NOP3 K8_NOP3
 669 #define K8_NOP7 K8_NOP4 K8_NOP3
 670 #define K8_NOP8 K8_NOP4 K8_NOP4
 671
 672 /* K7 nops */
 673 /* uses eax dependencies (arbitary choice) */
 674 #define K7_NOP1  GENERIC_NOP1
 675 #define K7_NOP2 ".byte 0x8b,0xc0\n"
 676 #define K7_NOP3 ".byte 0x8d,0x04,0x20\n"
 677 #define K7_NOP4 ".byte 0x8d,0x44,0x20,0x00\n"
 678 #define K7_NOP5 K7_NOP4 ASM_NOP1
 679 #define K7_NOP6 ".byte 0x8d,0x80,0,0,0,0\n"
 680 #define K7_NOP7        ".byte 0x8D,0x04,0x05,0,0,0,0\n"
 681 #define K7_NOP8        K7_NOP7 ASM_NOP1
 682
 683 #ifdef CONFIG_MK8
 684 #define ASM_NOP1 K8_NOP1
 685 #define ASM_NOP2 K8_NOP2
 686 #define ASM_NOP3 K8_NOP3
 687 #define ASM_NOP4 K8_NOP4
 688 #define ASM_NOP5 K8_NOP5
 689 #define ASM_NOP6 K8_NOP6
 690 #define ASM_NOP7 K8_NOP7
 691 #define ASM_NOP8 K8_NOP8
 692 #elif defined(CONFIG_MK7)
 693 #define ASM_NOP1 K7_NOP1
 694 #define ASM_NOP2 K7_NOP2
 695 #define ASM_NOP3 K7_NOP3
 696 #define ASM_NOP4 K7_NOP4
 697 #define ASM_NOP5 K7_NOP5
 698 #define ASM_NOP6 K7_NOP6
 699 #define ASM_NOP7 K7_NOP7
 700 #define ASM_NOP8 K7_NOP8
 701 #else
 702 #define ASM_NOP1 GENERIC_NOP1
 703 #define ASM_NOP2 GENERIC_NOP2
 704 #define ASM_NOP3 GENERIC_NOP3
 705 #define ASM_NOP4 GENERIC_NOP4
 706 #define ASM_NOP5 GENERIC_NOP5
 707 #define ASM_NOP6 GENERIC_NOP6
 708 #define ASM_NOP7 GENERIC_NOP7
 709 #define ASM_NOP8 GENERIC_NOP8
 710 #endif
 711
 712 #define ASM_NOP_MAX 8
 713
 714 /* Prefetch instructions for Pentium III and AMD Athlon */
 715 /* It's not worth to care about 3dnow! prefetches for the K6
 716    because they are microcoded there and very slow.
 717    However we don't do prefetches for pre XP Athlons currently
 718    That should be fixed. */
 719 #define ARCH_HAS_PREFETCH
 720 static inline void prefetch(const void *x)
 721 {
 722         alternative_input(ASM_NOP4,
 723                           "prefetchnta (%1)",
 724                           X86_FEATURE_XMM,
 725                           "r" (x));
 726 }
 727
 728 #define ARCH_HAS_PREFETCH
 729 #define ARCH_HAS_PREFETCHW
 730 #define ARCH_HAS_SPINLOCK_PREFETCH
 731
 732 /* 3dnow! prefetch to get an exclusive cache line. Useful for
 733    spinlocks to avoid one state transition in the cache coherency protocol. */
 734 static inline void prefetchw(const void *x)
 735 {
 736         alternative_input(ASM_NOP4,
 737                           "prefetchw (%1)",
 738                           X86_FEATURE_3DNOW,
 739                           "r" (x));
 740 }
 741 #define spin_lock_prefetch(x)   prefetchw(x)
 742
 743 extern void select_idle_routine(const struct cpuinfo_x86 *c);
 744
 745 #define cache_line_size() (boot_cpu_data.x86_cache_alignment)
 746
 747 extern unsigned long boot_option_idle_override;
 748 extern void enable_sep_cpu(void);
 749 extern int sysenter_setup(void);
 750
 751 extern int init_gdt(int cpu, struct task_struct *idle);
 752 extern void cpu_set_gdt(int);
 753 extern void secondary_cpu_init(void);
 754
 755 #endif /* __ASM_I386_PROCESSOR_H */